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CAT310
2.5 V UVLO
+
VCC
–
RESET
SCLK
SIN
XLAT
10 BIT SHIFT
REGISTER
10 BIT
DATA LATCHES
SOUT
OUT0
BLANK
OR
DISABLE
10 BIT DRIVER
VBATT
19 V
+
–
DRV0
DRV9
SW ? 0
SW ? 9
OUT9
GND
PGND
Figure 2. Block Diagram
http://onsemi.com
4
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